Nachweis von extrahirtem Thee durch Sublimation
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Formaler Nachweis der Fehlertoleranz von Schaltkreisen
While facing continuously shrinking feature sizes, the demand for fault tolerance in digital circuits increases. Numerous approaches to achieve such robustness on the design side have been presented. But ensuring that the fault tolerance is really achieved is a tough verification problem. Here, we propose a formal model and an effective algorithm to formally prove the robustness of a digital ci...
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ژورنال
عنوان ژورنال: Zeitschrift für Untersuchung der Nahrungs- und Genussmittel
سال: 1902
ISSN: 1438-2377,1438-2385
DOI: 10.1007/bf02508169